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Ingénieur en Digital Front-End, ASIC/FPGA/SoC, IA & RISC-V F/HAdvans Group • Montpellier (34), Occitanie
Ingénieur en Digital Front-End, ASIC/FPGA/SoC, IA & RISC-V F/H

Ingénieur en Digital Front-End, ASIC/FPGA/SoC, IA & RISC-V F/H

Advans Group • Montpellier (34), Occitanie
Il y a plus de 30 jours
Type de contrat
  • CDI
Description de poste

Nous sommes à la recherche de talentueux ingénieurs pour rejoindre nos équipes et contribuer à des projets stimulants dans les domaines de l'automobile, des supercalculateurs, de l'IoT et de la Défense.

En tant qu'ingénieur, vous serez un acteur clé dans le processus de conception de circuits intégrés, avec pour objectif principal l'intégration d'une intelligence artificielle via l'architecture RISC-V.

Voici les différentes tâches associées à la mission :

  • Collaborer activement à la définition des spécifications et de l'architecture du circuit intégré, en contribuant à la conception globale du projet.
  • Développer des descriptions de modules en utilisant des langages tels que VHDL, Verilog ou SystemVerilog, en mettant en avant votre expertise technique.
  • Mettre en œuvre avec précision la description RTL de ces blocs, en veillant à respecter les normes de qualité élevées.
  • Assurer la vérification approfondie des modules grâce à des tests unitaires et en mettant en pratique la méthodologie UVM pour garantir la fiabilité du circuit.
  • Superviser l'intégration au niveau top du circuit, en veillant à une cohérence optimale entre les différents blocs.
  • Élaborer et exécuter le plan de vérification en étroite collaboration avec l'équipe de vérification, en veillant à l'efficacité des processus.
  • Assurer un suivi proactif du développement, en intervenant sur la correction des bugs et en contribuant à l'enrichissement des fonctionnalités, démontrant ainsi un engagement continu envers l'amélioration du projet.

L'agence de rattachement de cette offre se situe à Nice Sophia-Antipolis.

Profil Recherché

  • Maitrise d'un langage de description RTL (VHDL, Verilog, SystemVerilog).
  • Première expérience en développement d'ASIC ou en prototypage FPGA.
  • Maitrise ou connaissance d'outils de conception tels que Synopsys, Cadence, Mentor, Siemens, Quartus, Vivado.
  • Expérience dans la gestion de versions avec GIT ou un équivalent.
  • Aptitude à travailler en anglais, aussi bien à l'écrit qu'à l'oral.

Avantages Salariaux

  • 10 jours de RTT par an
  • Allocation repas ou Titre restaurant presque intégralement pris en charge
  • Mutuelle Santé Famille
  • Compte Epargne Temps
  • Participation et Intéressement
  • Prime de cooptation de 1000 ou 1500 €
  • Prime de vacances
  • Prime Transport de 200 € net par an et 50 € brut mensuel.

Qui sommes-nous

ELSYS Design, c'est à l'origine l'histoire de deux ingénieurs, Radomir & François, qui ont choisi de fonder une entreprise spécialisée dans les systèmes embarqués.

Vous trouverez trois principaux domaines d'expertise chez ELSYS Design : la micro-électronique (FPGA, ASIC, SoC…), la carte électronique et le logiciel embarqué. Nous les mettons en œuvre au sein de nos bureaux d'études pour réaliser des solutions complètes, ou directement chez nos clients multisectoriels pour les aider à relever les défis liés à la conception et au développement de leurs technologies de pointe.

Nos fondateurs, business managers et équipes techniques sont tous ingénieurs de formation. Ils sont animés par une passion commune pour la technique, qui constitue un élément important de notre identité.

Si vous aussi, vous voulez écrire la suite de l'histoire avec nous, rejoignez ELSYS Design !


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Ingénieur en Digital Front-End, ASIC/FPGA/SoC, IA & RISC-V F/H • Montpellier (34), Occitanie

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