Après la course à l'entraînement des modèles, un nouveau défi s'impose : exécuter l'intelligence artificielle rapidement, efficacement et à grande échelle. Pour répondre à cet enjeu, VSORA, entreprise française de semi-conducteurs fondée en 2015, développe des accélérateurs de calcul dédiés à l’inférence IA.
Basée à Meudon-la-Forêt, VSORA est déjà implantée à Taïwan, en Corée, au Japon et aux États-Unis, et représente aujourd'hui l'unique alternative européenne à NVIDIA et AMD avec une architecture visant des performances plus de 3 fois supérieures par rapport aux solutions existantes.
Nous recherchons un(e) Ingénieur(e) Conception Hardware pour piloter le développement de bout en bout de cartes électroniques haute performance embarquant le chipset IA VSORA, selon le standard OCP Open Accelerator Infrastructure (OAI). L'objectif est de concevoir et fabriquer plusieurs cartes électroniques (OAM, UBB et cartes de test intermédiaires), en tant que designs de référence, destinées à être intégrées dans un serveur de calcul haute performance.
Ce poste couvre l'intégralité du cycle de vie hardware : de l'architecture et la conception schématique jusqu'au layout PCB, aux simulations, à la mise en service (bring-up) et au débogage.
Principales responsabilités :
• Définir l'architecture des cartes électroniques, en particulier la structure de gestion de l'alimentation et les composants capables de délivrer de forts courants au circuit intégré IA avec les performances PDN attendues en DC et AC.
• Réaliser les schématiques, les simulations pré-layout et sélectionner l'ensemble des composants nécessaires.
• Piloter l'exécution du layout PCB (externalisé), notamment : définition des contraintes, revue du routage des signaux haute vitesse, stratégie plans d'alimentation/masse, définition du stackup et suivi technique avec les fournisseurs PCB/PCBA.
• Réaliser et/ou piloter les simulations PI (Power Integrity) pour vérifier la chute de tension (IR Drop), les profils d'impédance et s'assurer que les performances globales du PDN répondent aux spécifications.
• Définir et exécuter la stratégie de simulation SI (Signal Integrity) pour valider les performances des signaux haute vitesse (PCIe Gen5 notamment).
• Mettre en place le laboratoire pour exécuter le bring-up, le débogage et la validation électronique des cartes.
Le/la candidat(e) idéal(e) est opérationnel(le), rigoureux(se) et expérimenté(e) sur des plateformes accélératrices haute vitesse et haute puissance et devra être doté des éléments suivants :
• Master (Bac+5) en génie électrique ou domaine connexe.
• 7 à 15 ans d'expérience pertinente en conception et développement hardware.
• Expertises avérées dans les domaines suivants :
– Capture de schématiques et supervision du layout de PCB complexes.
– Cartes PCB haute densité et multicouches (16 couches et plus).
– Expérience pratique de bring-up et de débogage en laboratoire.
• Une expérience dans un ou plusieurs des domaines suivants sera appréciée :
– Signaux haute vitesse : PCIe Gen5 ou interfaces équivalentes.
– Réseaux de distribution de puissance (PDN) pour ASICs ou FPGAs haute puissance.
– Analyses SI/PI avec des outils industriels reconnus.
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